llvm/test/CodeGen/NVPTX/envreg.ll

; RUN: llc < %s -march=nvptx -mcpu=sm_20 | FileCheck %s


declare i32 @llvm.nvvm.read.ptx.sreg.envreg0()
declare i32 @llvm.nvvm.read.ptx.sreg.envreg1()
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declare i32 @llvm.nvvm.read.ptx.sreg.envreg3()
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declare i32 @llvm.nvvm.read.ptx.sreg.envreg28()
declare i32 @llvm.nvvm.read.ptx.sreg.envreg29()
declare i32 @llvm.nvvm.read.ptx.sreg.envreg30()
declare i32 @llvm.nvvm.read.ptx.sreg.envreg31()


; CHECK: foo
define i32 @foo() {
; CHECK: mov.b32 %r{{[0-9]+}}, %envreg0
  %val0 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg0()
; CHECK: mov.b32 %r{{[0-9]+}}, %envreg1
  %val1 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg1()
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  %val2 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg2()
; CHECK: mov.b32 %r{{[0-9]+}}, %envreg3
  %val3 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg3()
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  %val4 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg4()
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  %val5 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg5()
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  %val6 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg6()
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  %val7 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg7()
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  %val8 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg8()
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  %val9 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg9()
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  %val10 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg10()
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  %val11 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg11()
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  %val12 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg12()
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  %val13 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg13()
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  %val16 = tail call i32 @llvm.nvvm.read.ptx.sreg.envreg16()
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  ret i32 %ret30
}